Características
• Alimentación estándar JEDEC de 1,5 V (rango de 1,425 V a 1,575 V).
• VDDQ igual a 1,5 V (rango de 1,425 V a 1,575 V).
• Frecuencia de reloj de 667 MHz para una tasa de transferencia de 1333 Mb/seg/pin.
• 8 bancos internos independientes.
• Latencia CAS ajustable: 9, 8, 7, 6.
• Latencia adicional programable: 0, CL - 2 o CL - 1 ciclos de reloj.
• Latencia de escritura CAS programable (CWL) = 7 (DDR3-1333).
• Precarga de 8 bits.
• Longitud de ráfaga: 8 (entrelazado sin límite, secuencial solo con dirección de inicio "000"), 4 con tCCD = 4, sin permitir lectura o escritura sin interrupciones (ya sea en tiempo real usando A12 o MRS).
• Estroboscopio de datos diferencial bidireccional.
• Calibración interna automática a través del pin ZQ (con resistencia RZQ de 240 ohm ± 1%).
• Terminación en chip mediante el pin ODT.
• Promedio de tiempo de actualización de 7,8 µs a temperaturas inferiores a TCASE de 85 °C, y 3,9 µs a temperaturas entre 85 °C y 95 °C.
• Rein
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